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  • 74HC107PW-Q100J
  • Nexperia/安世
  • new
  • TSSOP14
  • 控制逻辑器件 Dual J-K flip-flop with reset; negative-edge trigger
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  • 模拟和逻辑IC
  • 74HC107D,653
  • Nexperia/安世
  • new
  • SO14
  • 控制逻辑器件 Dual J-K flip-flop with reset; negative-edge trigger
  • -
  • 模拟和逻辑IC
  • 74HCT107D,653
  • Nexperia/安世
  • new
  • SO14
  • 控制逻辑器件 Dual J-K flip-flop with reset; negative-edge trigger; TTL enabled
  • -
  • 模拟和逻辑IC
  • 74HCT109D-Q100J
  • Nexperia/安世
  • new
  • SO16
  • 控制逻辑器件 Dual J-/K flip-flop with set and reset; positive-edge trigger; TTL enabled
  • -
  • 模拟和逻辑IC
  • 74HC109D,653
  • Nexperia/安世
  • new
  • SO16
  • 控制逻辑器件 Dual J-/K flip-flop with set and reset; positive-edge trigger
  • -
  • 模拟和逻辑IC
  • 74HC107D-Q100J
  • Nexperia/安世
  • new
  • SO14
  • 控制逻辑器件 Dual J-K flip-flop with reset; negative-edge trigger
  • -
  • 模拟和逻辑IC
  • 74HCT107D-Q100J
  • Nexperia/安世
  • new
  • SO14
  • 控制逻辑器件 Dual J-K flip-flop with reset; negative-edge trigger; TTL enabled
  • -
  • 模拟和逻辑IC
  • 74HC107PW,118
  • Nexperia/安世
  • new
  • TSSOP14
  • 控制逻辑器件 Dual J-K flip-flop with reset; negative-edge trigger
  • -
  • 模拟和逻辑IC
  • 74HC109D-Q100J
  • Nexperia/安世
  • new
  • SO16
  • 控制逻辑器件 Dual J-/K flip-flop with set and reset; positive-edge trigger
  • -
  • 模拟和逻辑IC
  • 74HCT109PW-Q100J
  • Nexperia/安世
  • new
  • TSSOP16
  • 控制逻辑器件 Dual J-/K flip-flop with set and reset; positive-edge trigger; TTL enabled
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  • 模拟和逻辑IC
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